見積依頼書(トレーニング)

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尚、ご希望講座の開催予定がない場合、又は下記開催日程以外での開催をご希望の場合は、
トレーニング開催リクエストよりお申込いただき、お申込ページ内の備考欄に「見積希望」と
ご入力ください。

お見積ご希望講座

  ※下記の表は日程順に記載されております。
  ※複数のトレーニングをお申込される場合はご希望の講座すべてにチェックをしてください。

申込講座名日程期間価格
(税込)
SystemVerilogセミナー
(アサーションコース)
19/01/29(火)〜01/30(水)
10:00〜18:00
2日間¥105,840
SystemCセミナー
(TLM入門コース)
19/01/31(木)
10:00〜18:00
1日間¥52,920
SystemCセミナー
(TLM実践コース)
19/02/01(金)
10:00〜18:00
1日間¥52,920
組込み分野
(Linux初級)
19/02/06(水)
10:00〜18:00
1日間¥27,000
SystemCセミナー
(入門コース)
19/02/07(木)〜02/08(金)
10:00〜18:00
2日間¥105,840
Verilog HDLセミナー
(RTL設計上級 機能検証)
19/02/14(木)〜02/15(金)
10:00〜18:00
2日間¥105,840
Verilog HDLセミナー
(RTL設計中級 論理合成)
19/02/21(木)〜02/22(金)
10:00〜18:00
2日間¥105,840
専門分野
(設計スタイルガイドセミナー・Verilog HDL版)
19/02/26(火)〜02/27(水)
10:00〜18:00
2日間¥105,840
Verilog HDLセミナー
(RTL設計初級)
19/03/13(水)〜03/15(金)
10:00〜18:00
3日間¥158,760
組込み分野
(組込みC言語入門)
19/03/19(火)〜03/20(水)
10:00〜18:00
2日間¥105,840
Verilog HDLセミナー
(RTL設計中級 機能検証)
19/03/28(木)〜03/29(金)
10:00〜18:00
2日間¥105,840
--SystemVerilogセミナー
(入門コース)
 
10:00〜18:00
2日間¥105,840
--Verilog HDLセミナー
(論理回路基礎)
 
10:00〜18:00
2日間¥105,840
--Verilog HDLセミナー
(RTL設計上級 論理合成)
 
10:00〜18:00
2日間¥105,840
--フレッシュマンセミナー
(RTL設計初級 実機演習講座)
 
10:00〜18:00
3日間¥158,760
--専門分野
新しい検証技術講座
 
10:00〜18:00
1日間¥52,920
--専門分野
検証スクリプト講座
 
10:00〜18:00
1日間¥52,920
--専門分野
(システム設計概論)
 
10:00〜18:00
2日間¥105,840
--専門分野
(設計スタイルガイドセミナー・VHDL版)
 
10:00〜18:00
2日間¥105,840
--専門分野
(RTL設計初級 VHDL)
 
10:00〜18:00
3日間¥158,760
--組込み分野
(MPU基礎)
 
10:00〜18:00
1日間¥52,920
--組込み分野
(ハードウェア基礎)
 
10:00〜18:00
2日間¥105,840


お見積申込者

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※個人申込の場合は「なし」とご記入ください

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※個人申込の場合は「なし」とご記入ください

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受講料のお支払いにつきましては、原則として「受講日の2日前までのご入金」をお願いしております。
詳細はESA・トレーニング受講(受験)申込規約をご確認ください。


  
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